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头上两幅图就是我的LCD屏的资料了。上面标了VBPD VFPD HBPD HFPD，没说VSPW、HSPW。
下面是我在代码中填写的值，可是是出现花屏哦，应该如何设置啊？
clkval_calc = 9;
#define LCD_VBPD ((18)&0xff)// 18 18 18
#define LCD_VFPD (( 4)&0xff)// 4 4 4
#define LCD_VSPW ((14)&0x3f)// 14 14 14
#define LCD_HBPD ((68)&0x7f)// 68 68 68
#define LCD_HFPD ((20)&0xff)// 20 20 20
#define LCD_HSPW ((55)&0xff)// 60 50 70
有人告诉我说，像这种3.5寸 16位 320x240 TFT屏 的参数都差不多的，参考一下别的值就可以了。
可是我用别人的几组值去试，效果更差，是白屏啊。
引用: 引用 6 楼 gooogleman 的回复:
当然不一样了-------------哈哈。很多人都中计了。
其实这个LCD和2440还有个驱动器的，你看看那个LCD背后的那个芯片的资料------------2440是直接和这个LCD驱动芯片打交道的。
这个帖子不错，先收藏。以前我也没有看明白，胡乱改就可以用了，有机会再看看了
引用: 引用 7 楼 hzdysymbol 的回复:
VSPW：TFT: Vertical sync pulse width determines the VSYNC pulse's high level width by counting the number of inactive lines.
HSPW：TFT: Horizontal sync pulse width determines the HSYNC pulse's high level width by counting the number of the VCLK.
VSPW指的是VSYNC处于高电平时的线的数目。
HSPW指的是HSYNC处于高电平时的VCLK的数目。
那这个不就是你屏的分辩率吗？
引用: 引用 11 楼 lijinyan3000 的回复:
引用 7 楼 hzdysymbol 的回复:
VSPW：TFT: Vertical sync pulse width determines the VSYNC pulse's high level width by counting the number of inactive lines.
HSPW：TFT: Horizontal sync pulse width determines the HSYNC pulse's high level width by counting the number of the VCLK.
VSPW指的是VSYNC处于高电平时的线的数目。
HSPW指的是HSYNC处于高电平时的VCLK的数目。
那这个不就是你屏的分辩率吗？…
引用: 引用 5 楼 lijinyan3000 的回复:
VSPW：TFT: Vertical sync pulse width determines the VSYNC pulse's high level width by counting the number of inactive lines.
HSPW：TFT: Horizontal sync pulse width determines the HSYNC pulse's high level width by counting the number of the VCLK.
VSPW指的是VSYNC处于高电平时的线的数目。
HSPW指的是HSYNC处于高电平时的VCLK的数目。
在我其它都不变的情况下，修改VBPD VFPD HBPD HFPD的值，有些…
引用: 引用 15 楼 frankizhong 的回复:
引用 5 楼 lijinyan3000 的回复:
VSPW：TFT: Vertical sync pulse width determines the VSYNC pulse's high level width by counting the number of inactive lines.
HSPW：TFT: Horizontal sync pulse width determines the HSYNC pulse's high level width by counting the number of the VCLK.
VSPW指的是VSYNC处于高电平时的线的数目。
HSPW指的是HSYNC处于高电平时的VCLK的数目。
在我其它都不变的情况下，修改…
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