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STLC5048

Fully programmable four-channel codec and filter

Features

■

Fully programmable monolithic 4-channel

codec/filter

Single +3.3 V supply

A/m law programmable

Linear coding (16 bits) option

PCM highway format automatically detected:

1.536 or 1.544 MHz, 2.048, 4.096, 8192 MHz

Two PCM ports available

TX gain programming: 33 dB range; <0.01 dB

step

RX gain programming: 42 dB range; <0.01 dB

step

Programmable SLIC input impedance

Programmable transhybrid balance filter

Programmable equalization (frequency

response)

Programmable time slot assignment

Digital and analog loopbacks

SLIC control port static (16 I/Os),

dynamic (12 I/Os + 4 CS)

TQFP64 (10x10x1.4mm)

Description

The STLC5048 is a monolithic fully programmable

4-channel codec and filter. It operates with a

single +3.3V supply.

The analog interface is based on a receive output

buffer driving the SLIC RX input and on an

amplifier input stage normally driven by the SLIC

TX output. Due to the single supply voltage a mid-

supply reference level is generated internally by

the device and all analog signals are referred to

this level (AGND). The PCM interface uses one

common 8 kHz frame sync. pulse for transmit and

receive direction. The bit clock is automatically

detected between four standards:

1.563/1.544 MHz, 2.048 MHz, 4.096 MHz,

8192 MHz.

Built-in test mode with tone generation, MCU

access to PCM data

64 TQFP (10x10mm) package

Programmable SLIC line current limitation

Programmable SLIC off-hook detection

threshold

-O

Two PCM port are provided: the channels can be

connected to port A or/and B.

Device programmability is achieved by means of

several registers and commands allowing to set

the different parameters like TX/RX gains, line

impedance, transhybrid balance, equalization

(frequency response), encoding law (A/m), time

slot assignment, independent channels power

up/down, loopbacks, PCM bits offset.

The STLC5048 can be programmed via serial

interface running up to 8 MHz. One interrupt

output pin is also provided.

A GUI interface is also available to emulate and

program the coefficients for impedance synthesis,

echo cancelling and channel filtering.

November 2007

Rev 9

1/64

www.st.com

Contents

STLC5048

Contents

Block diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8

Absolute maximum ratings and operating conditions . . . . . . . . . . . . . 9

Pin assignments and descriptions . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10

Functional description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14

4.1

4.2

4.3

4.4

4.5

4.6

4.7

4.8

4.9

4.10

4.11

4.12

4.13

Power on initialization . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14

Power down state . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14

Ringing state . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15

Impedance synthesis . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15

Echo canceling . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15

Transmit path . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15

Receive path . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 16

PCM interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17

MCU control interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18

Programming the device . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19

SLIC control interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20

DC SLIC programmability . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20

Built-in test . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20

5.1

I/O direction register (DIR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23

I/O data register channel #0 (DATA0) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23

I/O data register channel #1 (DATA1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24

I/O data register channel #2 (DATA2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25

I/O data register channel #3 (data3) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25

Persistency check register (PCHK-A/B) . . . . . . . . . . . . . . . . . . . . . . . . . . 26

Interrupt register (INT) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27

Interrupt mask register for I/O port (DMASK) . . . . . . . . . . . . . . . . . . . . . . 28

Interrupt mask register for interrupt (IMASK) . . . . . . . . . . . . . . . . . . . . . . 28

Alarm register (ALARM) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29

5.2

5.3

5.4

5.5

5.6

5.7

5.8

5.9

5.10

-O

2/64

STLC5048

Contents

5.11

5.12

5.13

5.14

5.15

5.16

5.17

5.18

5.19

5.20

5.21

5.22

5.23

5.24

5.25

5.26

5.27

5.28

5.29

5.30

5.31

5.32

5.33

5.34

Configuration register (CONF) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30

Command enable register (COMEN) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30

Synchronous check register (SYNCK) . . . . . . . . . . . . . . . . . . . . . . . . . . . 31

DSP status register (CTRLACK) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31

Checksum register (CKSUM) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31

Loopback register (LOOPB) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32

Transmit pre-amplifier gain register (TXG) . . . . . . . . . . . . . . . . . . . . . . . . 32

Receive amplifier gain register (RXG) . . . . . . . . . . . . . . . . . . . . . . . . . . . 33

SLIC line current limit reg (ILIM) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33

SLIC off-hook threshold register (ITH) . . . . . . . . . . . . . . . . . . . . . . . . . . . 34

PCM shift register (PCMSH) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34

PCM command register (PCMCOM) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34

Transmit time slot ch #0 (DXTS0) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36

Transmit time slot ch #1 (DXTS1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36

Transmit time slot ch #2 (DXTS2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37

Transmit time slot ch #3 (DXTS3) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37

Receive time slot ch #0 (DRTS0) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38

Receive time slot ch #1 (DRTS1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39

Receive time slot ch #2 (DRTS2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39

Receive time slot ch #3 (DRTS3) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40

PCMW data register (PCMWD) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40

PCMR data register (PCMRD) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41

PCM control register (PCMCTRL) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41

Tone generation register (TONEG) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42

Coefficient state register (COEFST) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42

Software revision ID Code (SWRID) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42

Hardware revision ID code (HWRID) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43

5.36

5.37

6.1

6.2

5.35

-O

Single byte instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44

Realignment command (REACOM) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44

Start checksum calculation (CKSTART) . . . . . . . . . . . . . . . . . . . . . . . . . . 44

Command list . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45

3/64

Contents

STLC5048

Command description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46

8.1

8.2

8.3

8.4

8.5

8.6

8.7

8.8

8.9

8.10

Block enable command (BLKEN) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46

KD filter (KDF) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46

AFE coefficient (AFE_CFF) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 47

Timeout value (T_OUT) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 47

Receive gain (GRX) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 48

Transmit gain (GTX) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 48

R filter coefficient (RFC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 48

X filter coefficient (XFC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 49

B filter coefficient (BFC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 49

Z filter coefficient (ZFC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 49

Electrical characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 50

Package mechanical data . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 57

Appendix A Absolute gains in kit with L3235N/STLC3080 . . . . . . . . . . . . . . . . . 58

Appendix B STLC5048 application diagrams. . . . . . . . . . . . . . . . . . . . . . . . . . . . 60

Appendix C Power sequences. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 62

C.1

C.2

Power-up sequence. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 62

Power-on sequence. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 62

Ordering information . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 63

Revision history . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 63

-O

4/64

STLC5048

List of tables

Table 1.

Table 2.

Table 3.

Table 4.

Table 5.

Table 6.

Table 7.

Table 8.

Table 9.

Table 10.

Table 11.

Table 12.

Table 13.

Table 14.

Table 15.

Table 16.

Table 17.

Table 18.

Table 19.

Table 20.

Table 21.

Table 22.

Table 23.

Table 24.

Table 25.

Table 26.

Table 27.

Table 28.

Table 29.

Table 30.

Table 31.

Table 32.

Table 33.

Table 34.

Table 35.

Table 36.

Table 37.

Table 38.

Table 39.

Table 40.

Table 41.

Table 42.

Table 43.

Table 44.

Table 45.

Table 46.

Table 47.

Table 48.

Absolute maximum ratings . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9

Operating range . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9

Thermal data. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9

I/O definitions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10

Pin descriptions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11

Instruction byte structure . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18

Register addresses . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20

I/O direction register (DIR) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23

Dynamic I/O data register channel #0 (DATA0) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23

Static I/O data register channel #0 (DATA0) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24

Dynamic I/O data register channel #1 (DATA1) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24

Static I/O data register channel #1 (DATA1) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24

Dynamic I/O data register channel #2 (DATA2) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25

Static I/O data register channel #2 (DATA2) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25

Dynamic I/O data register channel #3 (data3) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25

Dynamic I/O data register channel #3 (data3) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26

A and B inputs of persistency check register in static mode. . . . . . . . . . . . . . . . . . . . . . . . 26

Persistency check register (PCHK-A/B) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26

Interrupt register (INT) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27

Interrupt mask register for I/O port (DMASK) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28

Interrupt mask register for interrupt (IMASK) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28

Alarm register (ALARM) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29

Configuration register (CONF) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30

Command enable register (COMEN) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30

Synchronous check register (SYNCK) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31

DSP status register (CTRLACK) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31

Checksum register (CKSUM) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31

Loopback register (LOOPB) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32

Transmit pre-amplifier gain register (TXG) bits. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32

Receive amplifier gain register (RXG) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33

SLIC line current limit reg (ILIM) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33

SLIC off-hook threshold register (ITH) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34

PCM shift register (PCMSH) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34

PCM command register (PCMCOM) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34

PCM command register (PCMCOM) TPB and TPA bit combinations . . . . . . . . . . . . . . . . 35

PCM command register (PCMCOM) PC0 and PC1 bit combinations . . . . . . . . . . . . . . . . 35

Transmit time slot ch #0 (DXTS0) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36

Transmit time slot ch #0 (DXTS0) time slots in linear mode . . . . . . . . . . . . . . . . . . . . . . . . 36

Transmit time slot ch #1 (DXTS1) bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36

Transmit time slot ch #1 (DXTS1) time slots in linear mode . . . . . . . . . . . . . . . . . . . . . . . . 37

-O

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项目描述为了检测传火管各个喷口一致性是否良好。该系统实现了对传火管的一致性的自动化检测。传火管的一致性指标包括火焰温度、火焰冲量、管壳压力分布、管壳温度分布。该系统运用了薄膜型快速相应热电偶动态温度传感技术和高速动态压力传感技术，结合先进虚拟仪器技术保证了传火管输出性能测试系统的高精度、高可靠的自动化测试。技术指标测量传火管输出性能，包括火焰动态温度、动态压力、冲量和管内动...[详细]
基于ARM的人体生理参数监护系统的设计

1 引言随着我国经济的快速发展、城市化进程的日益加速、人们生活节奏的不断加快，越来越多的人们开始感到自己的健康每况愈下，很多人直至病情突发才明白。据报道，我国绝大多数人都处于亚健康状态。随着现代电子技术的发展，16／32位CPU的广泛应用，传统的生理信号监护仪的CPU系统也在逐渐的由8位 CPU向更高位数的处理器发展。随着监护仪功能的强大，对数据处理速度的要求越来越高，使得8位CPU的发展受...[详细]
恩智浦UMA技术助力美国首次全国性固话-移动融合商用服务

Nexperia EDGE移动系统解决方案使手机能够在移动网络和 Wi-Fi热点之间实现无缝切换中国，北京，2007 年7月13日 –恩智浦半导体（NXP Semiconductors）（由飞利浦创建的独立半导体公司）今天宣布其“非授权移动接入”（UMA）手机解决方案已用于北美首个基于UMA的全国范围商用服务。这项T-Mobile HotSpot @HomeSM服务由T-Mobile US...[详细]
安捷伦综测仪E6601A的TD手机校准方案

E6601A是安捷伦公司新一代综测仪平台，旨在为手机制造商提供低成本的校准方案。它采用开放式Windows XP 平台，用户能够在测试仪上直接开发、下载和执行测试程序，大大节省了传统测试系统空间和成本；其专门为高速测量而设计的全新测量架构和业界领先的精度、可重复性和测量完整性，能够显著降低手机测试成本；其灵活的许可证，使用户能够通过购买最适合其制造需要的许可证选件，来有效地降低设备成本...[详细]
基于89C2051的步进电机驱动系统设计

引言步进电动机驱动方式主要分为恒压驱动、恒流驱动、细分驱动等，其中恒压驱动是成本最低、最简单的解决方案，但是它的显著缺点是：高频力矩下降较快，无法满足某些应用场合的要求。另外，目前市场上几乎所有的步进电机驱动器都存在着低频热耗散大的缺点。在成本压力较大、对功耗和高低频力矩都有较高要求的情况下，如何取舍是一件很难抉择的事情。本设计通过一个低成本可控电源，针对控制频率的全程范围，相应输出若干段电压...[详细]
STM32手册上的SPI/I2S及USART/UART识读话题

我们在做STMCU开发的前期往往需要作芯片的选型，一般先会看选型手册和数据手册。其中有两个地方经常让人一下子难解其意。一个是关于USART/UART的地方，另一个是关于SPI/I2S的地方。先不妨以STM32F407为例。下面是STMCU选型手册和数据手册相关信息的截图。从选型手册上看到，STM32F407 的SPI 标了3个，I2S标了2个。这里往往会被误解...[详细]
秒杀iPad：外媒为何力挺华为M5？

科研实力强悍的华为，正在各个消费电子领域四处出击，除了最为成功的智能手机领域，在平板上，也赢得业界的一致好评。外国科技媒体GearDiary在去年评测华为平板时，因其坚固的外壳、光滑的造型、哈曼卡顿的音效和极具竞争力的价格，GearDiary称它为“性价比最高的安卓平板”。华为平板M5发布之后，GearDiary随之对8．4寸华为平板M5进行了评测，并称“这款平板可能会秒杀iPad”。外...[详细]
华为遭到欧盟委员会主席点名，欧洲5G部署计划恐将落空？

据外媒Rappler报道，欧盟委员会主席仍在质疑华为设备可能会被用于间谍活动。当地时间周五，欧盟委员会主席乌苏拉·冯·德莱恩（Ursula von der Leyen）在接受德国《明镜》周刊采访时表示，如果欧洲公民及企业的信息会成为被传递的情报，那么欧盟便不会同意华为参与部署5G网络。冯·德莱恩指出，欧盟委员会正准备就5G网络安全问题制定一套通用的标准。冯·德莱恩还强调，超高速的5G移动网...[详细]
中国移动要推一款超廉价全面屏手机竟然有三个摄像头

一直以来，各大运营商定制的话费手机通常都给人不太高端的印象，这也是运营商定制的策略，将用户绑在自己的网络下就完成任务，毕竟话费最终还将流到自己的腰包里。不过随着全网通手机的普及以及成为国际标准，运营商的这条战略越来越不好过，因此定制机向着高性价比的路线迈进也是很有可能，例如在今日曝光的一台来自中国移动(微博)的定制机就采用了全面屏设计。知名数码用户@熊本科技在微博曝光了一台与小米M...[详细]
安防智能巡检机器人，实现24小时巡检

如今在技术赋能产业的大背景下，处处显生机！伴随着进入安防领域，安防行业迎来全新机遇，而近些年人力资源成本逐步提高，以人力为主的安保防控体系面临巨大考验，而通过机器人与安防设备的结合，将有效替代安保人员执行高危险性任务。一、人工安防巡检存在的问题 1、传统人工巡视、手工纸介记录的工作方式人工录入效率低、出错率高； 2、手工巡检工作量大、难到位、常漏检； 3、信...[详细]
奔驰全LED大灯介绍成为主流大势所趋

你还在为是否为了选择一款配备氙气大灯的车型而多花几千块钱吗？你还在想办法为自己的爱车改装氙气大灯吗？很可惜，氙气大灯很可能已经快要OUT了，现在全LED大灯已经走进了汽车世界。 LED灯从其开始在汽车上使用到现在也不过几年时间，但是其迅猛的发展势头却令人惊讶。2008年，在奥迪A4上率先开始采用LED的示宽灯，LED开始正式配备于汽车上。短短几年时间内，各个厂商都开始普遍采用LED示宽灯。甚...[详细]
华为三款千元机齐曝光：Y6(2018)外观确认

千元档位，华为将推出多款Y系列产品手机产品，国外爆料者Evan Blass带来了华为Y3、Y5 Prime以及华为Y6的真机，其中Y6(2018)并非首次出现，其外观已经在此前得到确认。　　几款产品延续了此前华为的设计风格，入门级产品华为Y3没有采用全面屏设计，依然采用了双摄像头，旁边为扬声器与补光灯。　　华为Y5 Prime则采用了18：9比例屏幕设计，不过从图片来看并没有...[详细]