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NAND01GW4B2AZB6

128M X 8 FLASH 3V PROM, 35 ns, PDSO48

器件类别:存储   

厂商名称:ST(意法半导体)

厂商官网:http://www.st.com/

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器件参数
参数名称
属性值
功能数量
1
端子数量
48
最小工作温度
-40 Cel
最大工作温度
85 Cel
额定供电电压
3 V
最小供电/工作电压
2.7 V
最大供电/工作电压
3.6 V
加工封装描述
12 X 20 MM, PLASTIC, TSOP-48
状态
Contact Mfr
ccess_time_max
35 ns
jesd_30_code
R-PDSO-G48
jesd_609_code
e0
存储密度
1.02E9 bit
内存IC类型
FLASH
内存宽度
8
moisture_sensitivity_level
NOT SPECIFIED
位数
1.28E8 words
位数
128M
操作模式
ASYNCHRONOUS
组织
128MX8
包装材料
PLASTIC/EPOXY
ckage_code
TSOP1
包装形状
RECTANGULAR
包装尺寸
SMALL OUTLINE, THIN PROFILE
串行并行
PARALLEL
eak_reflow_temperature__cel_
NOT SPECIFIED
gramming_voltage__v_
3
qualification_status
COMMERCIAL
seated_height_max
1.2 mm
表面贴装
YES
温度等级
INDUSTRIAL
端子涂层
TIN LEAD
端子形式
GULL WING
端子间距
0.5000 mm
端子位置
DUAL
ime_peak_reflow_temperature_max__s_
NOT SPECIFIED
length
18.4 mm
width
12 mm
文档预览
NAND01G-B
NAND02G-B
1 Gbit, 2 Gbit,
2112 Byte/1056 Word Page, 1.8V/3V, NAND Flash Memory
Feature summary
High Density NAND Flash memories
Up to 2 Gbit memory array
Up to 64Mbit spare area
Cost effective solutions for mass
storage applications
x8 or x16 bus width
Multiplexed Address/ Data
Pinout compatibility for all densities
FBGA
NAND interface
TSOP48 12 x 20mm
Supply voltage
1.8V device: V
DD
= 1.7 to 1.95V
3.0V device: V
DD
= 2.7 to 3.6V
x8 device: (2048 + 64 spare) Bytes
x16 device: (1024 + 32 spare) Words
x8 device: (128K + 4K spare) Bytes
x16 device: (64K + 2K spare) Words
Random access: 25µs (max)
Sequential access: 50ns (min)
Page program time: 300µs (typ)
Page size
VFBGA63 9.5 x 12 x 1mm
TFBGA63 9.5 x 12 x 1.2mm
Block size
Serial Number option
Data protection
Hardware and Software Block Locking
Hardware Program/Erase locked during
Power transitions
100,000 Program/Erase cycles
10 years Data Retention
Page Read/Program
Data integrity
Copy Back Program mode
Fast page copy without external
buffering
Internal Cache Register to improve the
program and read throughputs
Block erase time: 2ms (typ)
ECOPACK
®
packages
Development tools
Error Correction Code software and
hardware models
Bad Blocks Management and Wear
Leveling algorithms
File System OS Native reference
software
Hardware simulation models
Cache Program and Cache Read modes
Fast Block Erase
Status Register
Electronic Signature
Chip Enable ‘don’t care’
for simple interface with microcontroller
February 2006
Rev 4.0
1/64
www.st.com
2
NAND01G-B, NAND02G-B
Table 1.
Product List
(1)
Reference
Part Number
NAND01GR3B
NAND01GW3B
NAND01G-B
NAND01GR4B
NAND01GW4B
NAND02GR3B
NAND02GW3B
NAND02G-B
NAND02GR4B
NAND02GW4B
1. x16 organization only available for MCP Products.
2/64
NAND01G-B, NAND02G-B
Contents
Contents
1
2
Summary description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8
Memory array organization . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15
2.1
Bad blocks . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15
3
Signal descriptions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17
3.1
3.2
3.3
3.4
3.5
3.6
3.7
3.8
3.9
3.10
3.11
3.12
Inputs/Outputs (I/O0-I/O7) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17
Inputs/Outputs (I/O8-I/O15) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17
Address Latch Enable (AL) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17
Command Latch Enable (CL) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17
Chip Enable (E) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17
Read Enable (R) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17
Power-Up Read Enable, Lock/Unlock Enable (PRL) . . . . . . . . . . . . . . . . 18
Write Enable (W) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
Write Protect (WP) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
Ready/Busy (RB) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
V
DD
Supply Voltage . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
V
SS
Ground . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
4
Bus operations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
4.1
4.2
4.3
4.4
4.5
4.6
Command Input . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
Address Input . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
Data Input . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
Data Output . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20
Write Protect . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20
Standby . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20
5
6
Command Set . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22
Device operations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
6.1
Read Memory Array . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
6.1.1
Random Read . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
3/64
Contents
6.1.2
NAND01G-B, NAND02G-B
Page Read . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
6.2
6.3
Cache Read . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
Page Program . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
6.3.1
6.3.2
Sequential Input . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
Random Data Input . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
6.4
6.5
6.6
6.7
6.8
Copy Back Program . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29
Cache Program . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31
Block Erase . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32
Reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32
Read Status Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33
6.8.1
6.8.2
6.8.3
6.8.4
6.8.5
6.8.6
Write Protection Bit (SR7) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33
P/E/R Controller and Cache Ready/Busy Bit (SR6) . . . . . . . . . . . . . . . 33
P/E/R Controller Bit (SR5) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33
Cache Program Error Bit (SR1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34
Error Bit (SR0) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34
SR4, SR3 and SR2 are Reserved . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34
6.9
Read Electronic Signature . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35
7
Data protection . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
7.1
7.2
7.3
7.4
Blocks Lock . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
Blocks Unlock . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
Blocks Lock-Down . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
Block Lock Status . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
8
Software algorithms . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40
8.1
8.2
8.3
8.4
8.5
8.6
Bad Block Management . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40
Block Replacement . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40
Garbage Collection . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42
Wear-leveling algorithm . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42
Error Correction Code . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42
Hardware Simulation models . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43
8.6.1
8.6.2
Behavioral simulation models . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43
IBIS simulations models . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43
9
Program and Erase Times and Endurance cycles . . . . . . . . . . . . . . . . 44
4/64
NAND01G-B, NAND02G-B
Contents
10
11
Maximum rating . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45
DC And AC parameters . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46
11.1
11.2
Ready/Busy Signal electrical characteristics . . . . . . . . . . . . . . . . . . . . . . 57
Data Protection . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 58
12
13
14
Package mechanical . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 59
Part numbering . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 62
Revision history . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 63
5/64
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