SY100EL14VZCTR,SY100EL14VZCTR pdf中文资料,SY100EL14VZCTR引脚图,SY100EL14VZCTR电路-Datasheet-电子工程世界

文档预览

5V/3.3V 1:5 CLOCK

DISTRIBUTION

FEATURES

3.3V and 5V power supply options

Typical 30ps output-to-output skew

Max. 50ps output-to-output skew

Synchronous enable/disable

Multiplexed clock input

75K

Ω

internal input pull-down resistors

ClockWorks™

SY100EL14V

FINAL

DESCRIPTION

The SY100EL14V is a low skew 1:5 clock distribution

chip designed explicitly for low skew clock distribution

applications. The device can be driven by either a

differential or single-ended ECL or, if positive power

supplies are used, PECL input signal. The EL14V is

suitable for operation in systems operating from 3.3V to

5.0V supplies. If a single-ended input is to be used the

output should be connected to the CLK input and

bypassed to ground via a 0.01µF capacitor. The V

output is designed to act as the switching reference for

the input of the EL14V under single-ended input

conditions, as a result this pin can only source/sink up to

0.5mA of current.

The EL14V features a multiplexed clock input to allow

for the distribution of a lower speed scan or test clock

along with the high speed system clock. When LOW (or

left open and pulled LOW by the input pull-down resistor)

the SEL pin will select the differential clock input.

The common enable (EN) is synchronous so that the

outputs will only be enabled/disabled when they are

already in the LOW state. This avoids any chance of

generating a runt clock pulse when the device is enabled/

disabled as can happen with an asynchronous control.

The internal flip flop is clocked on the falling edge of the

input clock, therefore all associated specification limits

are referenced to the negative edge of the clock input.

When both differential inputs are left open, CLK input

will pull down to V

and CLK input will bias around

/2.

Available in 20-pin SOIC package

PIN CONFIGURATION/BLOCK DIAGRAM

EN VCC NC SCLK CLK CLK V

SEL V

20 19 18 17 16 15 14 13 12 11

SOIC

TOP VIEW

PIN NAMES

CLK

SCLK

SEL

0-4

Function

Differential Clock Inputs

Scan Clock Input

Synchronous Enable

Clock Select Input

Reference Output

Differential Clock Outputs

TRUTH TABLE

CLK

SCLK

SEL

* On next negative transition of CLK or SCLK

Rev.: A

Amendment: /0

Issue Date: October 1999

Micrel

ClockWorks™

SY100EL14V

ABSOLUTE MAXIMUM RATINGS

(1)

Symbol

I(3)

OUT

Power Supply (V

= 0V)

Input Voltage (V

= 0V)

Output Current

- Continuous

- Surge

Operating Temperature Range

Operating Range

(1),(2)

Rating

Value

-8.0 to 0

0 to -6.0

100

-40 to +85

-5.7 to -3.0

Unit

VDC

°C

NOTES:

1. Absolute maximum rating, beyond which, device life may be impaired, unless otherwise specified on an individual data sheet.

2. Parametric values specified at:

100EL14V Series: -3.0V to -5.5V.

3. In PECL mode operation, V

(Max) = V

DC ELECTRICAL CHARACTERISTICS

= V

(Min) to V

(Max); V

= GND

(1)

= –40

Symbol

OHA

OLA

Parameter

Output HIGH Voltage

(2)

Output LOW Voltage

(2)

Output HIGH Voltage

(2)

Output LOW Voltage

(2)

Input HIGH Voltage

Input LOW Voltage

Input LOW Current

(3)

CLK

Input High Current

Power Supply Current

Output Reference

Voltage

Min.

Typ.

Max.

-880

Min.

-1025

-1085 -1005

= 0

Typ.

-955

Max.

-880

= +25

Min.

-1025

Typ.

-955

Max.

-880

= +85

Min.

-1025

Typ.

-955

Max.

-880

Unit

µA

-1830 -1695 -1555 -1810 -1705 -1620 -1810 -1705 -1620 -1810 -1705 -1620

-1095

—

-1165

-1810

0.5

-300

—

-1.38

—

-1555

-880

-1035

—

-1165

—

-1610

-880

-1035

—

-1165

—

-1610

-880

-1035

—

-1165

—

-1610

-880

-1475

—

150

-1.26

-1475 -1810

—

150

-1.26

0.5

-300

—

-1.38

-1475 -1810

—

150

-1.26

0.5

-300

—

-1.38

-1475 -1810

—

150

-1.26

0.5

-300

—

-1.38

NOTES:

1. This table replaces the three traditionally seen in ECL 100K data books. The same DC parameter values at V

= -4.5V now apply across the full V

range of -3.0V to -5.5V. Outputs are terminated through a 50Ω resistor to -2.0V except where otherwise specified on the individual data sheets.

2. V

= V

(Max) or V

(Min).

3. V

= V

(Max).

Micrel

ClockWorks™

SY100EL14V

AC ELECTRICAL CHARACTERISTICS

= V

(Min) to V

(Max); V

= GND

= –40

Symbol

PLH

PHL

Parameter

Propagation Delay

CLK to Q (Diff)

CLK to Q (SE)

SCLK to Q

Part-to-Part Skew

(1)

Within-Device Skew

Setup Time EN

Hold Time EN

Minimum Input

Swing

CLK

Min.

520

470

—

150

200

150

Max.

720

770

200

—

= 0

Min.

550

500

—

150

200

150

Max.

750

800

200

—

Min.

580

530

—

150

200

150

= +25

Typ.

680

—

Max.

780

830

200

—

= +85

Min.

630

580

—

150

200

150

Max.

830

880

200

—

-2.0

-1.8

230

-0.4

500

-2.1

-1.9

230

-0.4

500

-2.1

-1.9

230

—

360

-0.4

500

-2.1

-1.9

230

-0.4

500

Unit

skew

CMR

Common Mode Range

(2)

< 500mV

≥

500mV

Output Rise/Fall Times

Q (20% – 80%)

NOTES:

1. Skews are specified for identical LOW-to-HIGH or HIGH-to-LOW transitions.

2. The V

CMR

range is referenced to the most positive side of the differential input signal. Normal operation is obtained if the HIGH level falls within the specified

range and the peak-to-peak voltage lies between V

(Min) and 1V. The lower end of the V

CMR

range varies 1:1 with V

. The numbers in the specification

table assume a nominal V

= -3.3V. For PECL operation, the V

CMR

(Min) will be fixed at 3.3V – |V

CMR

(Min)|.

PRODUCT ORDERING CODE

Ordering

Code

SY100EL14VZC

SY100EL14VZCTR

Package

Type

Z20-1

Operating

Range

Commercial

Micrel

ClockWorks™

SY100EL14V

20 LEAD SOIC .300" WIDE (Z20-1)

Rev. 03

MICREL-SYNERGY

TEL

3250 SCOTT BOULEVARD SANTA CLARA CA 95054 USA

FAX

+ 1 (408) 980-9191

+ 1 (408) 914-7878

WEB

http://www.micrel.com

This information is believed to be accurate and reliable, however no responsibility is assumed by Micrel for its use nor for any infringement of patents or

other rights of third parties resulting from its use. No license is granted by implication or otherwise under any patent or patent right of Micrel Inc.

型号	SY100EL14VZCTR	SY100EL14VZITR
描述	Low Skew Clock Driver, 100EL Series, 5 True Output(s), 0 Inverted Output(s), ECL, PDSO20, 0.300 INCH, SOIC-20	Low Skew Clock Driver, 100EL Series, 5 True Output(s), 0 Inverted Output(s), ECL, PDSO20, 0.300 INCH, SOIC-20
是否Rohs认证	不符合	不符合
厂商名称	Micrel ( Microchip )	Micrel ( Microchip )
零件包装代码	SOIC	SOIC
包装说明	SOP, SOP20,.4	SOP, SOP20,.4
针数	20	20
Reach Compliance Code	not_compliant	not_compliant
系列	100EL	100EL
输入调节	DIFFERENTIAL MUX	DIFFERENTIAL MUX
JESD-30 代码	R-PDSO-G20	R-PDSO-G20
JESD-609代码	e0	e0
长度	12.83 mm	12.83 mm
逻辑集成电路类型	LOW SKEW CLOCK DRIVER	LOW SKEW CLOCK DRIVER
湿度敏感等级	1	1
功能数量	1	1
端子数量	20	20
实输出次数	5	5
最高工作温度	85 °C	85 °C
封装主体材料	PLASTIC/EPOXY	PLASTIC/EPOXY
封装代码	SOP	SOP
封装等效代码	SOP20,.4	SOP20,.4
封装形状	RECTANGULAR	RECTANGULAR
封装形式	SMALL OUTLINE	SMALL OUTLINE
峰值回流温度（摄氏度）	240	240
电源	-3.3/-5 V	-3.3/-5 V
Prop。Delay @ Nom-Sup	0.88 ns	0.88 ns
传播延迟（tpd）	0.83 ns	0.83 ns
认证状态	Not Qualified	Not Qualified
Same Edge Skew-Max（tskwd）	0.05 ns	0.05 ns
座面最大高度	2.65 mm	2.65 mm
表面贴装	YES	YES
技术	ECL	ECL
温度等级	COMMERCIAL EXTENDED	INDUSTRIAL
端子面层	Tin/Lead (Sn85Pb15)	Tin/Lead (Sn85Pb15)
端子形式	GULL WING	GULL WING
端子节距	1.27 mm	1.27 mm
端子位置	DUAL	DUAL
处于峰值回流温度下的最长时间	30	30
宽度	7.52 mm	7.52 mm

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