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综合时序约束的FPGA和ASICzip
1星 发布者: hellopinkgirls

2013-09-22 | 1积分 | 218.79KB |  1 次下载

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文档简介
标签: FPGA

FPGA

ASIC

ASIC

时序约束

时序约束

电子系统设计人员使用FPGA来实现他们的原型开发,利用器件的可编程能力验证硬件和软件。一旦设计准备好进行量产时,设计人员寻找某类ASIC以达到功耗、性能和成本目标,特别是,能够提供硬件平台和工具包的ASIC,支持目前采用了FPGA的设计,可以使用相同的I/O、存储器资源和IP。依据这些标准,设计人员降低了ASIC设计出现功能或者时序错误的风险。本文讨论Altera HardCopy ASIC的发展、体系结构和功能,它作为封装和引脚兼容FPGA匹配器件,非常适合实现设计量产。

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