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四选一多路选择器Verilog代码及仿真结果
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module muxdfabcds1s0yinput abcds1s0output yassign ys1 s0a s1 s0b s1 s0c dendmodulemodule muxtbreg abcds1s0wire ydfmuxdf muxdftbaa bb cc dd s1s1 s0s0 yydfinitialbegin a0 b0 c0 d0 s10 s00endalways 1 aaalways 2 bbalways 4 ccalways 8 ddalways 16 s1s1always 32 s0s0endmodule......
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