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周立功FusionStartKit,fpga开发板的实验例程,恒定系数乘法器实验rar
1星 发布者: 论文帝

2013-07-01 | 1积分 | 1.02MB |  3 次下载

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文档简介
标签: 周立功

周立功

开发

开发

开发板

开发板

实验

实验

例程

例程

恒定系数乘法器实验\Project\multiply\constraint\multiply.pdc

..................\.......\........\..........\multiply_1.pdc

..................\.......\........\designer\impl1\designer.log

..................\.......\........\........\.....\designer_gen_ba.log

..................\.......\........\........\.....\multiply.adb

..................\.......\........\........\.....\.........dtf\verify.log

..................\.......\........\........\.....\multiply.ide_des

..................\.......\........\........\.....\multiply.pdb

..................\.......\........\........\.....\multiply.pdb.depends

..................\.......\........\........\.....\multiply.stp

..................\.......\........\........\.....\multiply.tcl

..................\.......\........\........\.....\multiply_ba.sdf

..................\.......\........\........\.....\multiply_ba.v

..................\.......\........\........\.....\simulation\postlayout\multiply\verilog.psm

..................\.......\........\........\.....\..........\..........\........\_primary.dat

..................\.......\........\........\.....\..........\..........\........\_primary.vhd

..................\.......\........\........\.....\..........\..........\stimulus\verilog.psm

..................\.......\........\........\.....\..........\..........\........\_primary.dat

..................\.......\........\........\.....\..........\..........\........\_primary.vhd

..................\.......\........\........\.....\..........\..........\tb_clock_minmax\verilog.psm

..................\.......\........\........\.....\..........\..........\...............\_primary.dat

..................\.......\........\........\.....\..........\..........\...............\_primary.vhd

..................\.......\........\........\.....\..........\..........\.estbench\verilog.psm

..................\.......\........\........\.....\..........\..........\.........\_primary.dat

..................\.......\........\........\.....\..........\..........\.........\_primary.vhd

..................\.......\........\........\.....\..........\..........\_info

..................\.......\........\hdl\hdlsynchk.tcl

..................\.......\........\...\loader.v

..................\.......\........\...\multiplier.v

..................\.......\........\...\multiply.v

..................\.......\........\...\waveperl.log

..................\.......\........\multiply.prj

..................\.......\........\simulation\meminit.dat

..................\.......\........\..........\modelsim.ini

..................\.......\........\..........\modelsim.ini.sav

..................\.......\........\..........\modelsim.log

..................\.......\........\..........\presynth\@p@l@l_1@m\verilog.psm

..................\.......\........\..........\........\..........\_primary.dat

..................\.......\........\..........\........\..........\_primary.vhd

..................\.......\........\..........\........\loader\verilog.psm

..................\.......\........\..........\........\......\_primary.dat

..................\.......\........\..........\........\......\_primary.vhd

..................\.......\........\..........\........\multiplier\verilog.psm

..................\.......\........\..........\........\..........\_primary.dat

..................\.......\........\..........\........\..........\_primary.vhd

..................\.......\........\..........\........\.......y\verilog.psm

..................\.......\........\..........\........\........\_primary.dat

..................\.......\........\..........\........\........\_primary.vhd

..................\.......\........\..........\........\ram16x8\verilog.psm

..................\.......\........\..........\........\.......\_primary.dat

..................\.......\........\..........\........\.......\_primary.vhd

..................\.......\........\..........\........\stimulus\verilog.psm

..................\.......\........\..........\........\........\_primary.dat

..................\.......\........\..........\........\........\_primary.vhd

..................\.......\........\..........\........\tb_clock_minmax\verilog.psm

..................\.......\........\..........\........\...............\_primary.dat

..................\.......\........\..........\........\...............\_primary.vhd

..................\.......\........\..........\........\.estbench\verilog.psm

..................\.......\........\..........\........\.........\_primary.dat

..................\.......\........\..........\........\.........\_primary.vhd

..................\.......\........\..........\........\_info

..................\.......\........\..........\ram16x8_R0C0.mem

..................\.......\........\..........\run.do

..................\.......\........\..........\vsim.wlf

..................\.......\........\.martgen\PLL_1M\PLL_1M.cxf

..................\.......\........\........\......\PLL_1M.gen

..................\.......\........\........\......\PLL_1M.log

..................\.......\........\........\......\PLL_1M.v

..................\.......\........\........\PLL_1M_work.ixf

..................\.......\........\........\ram16x8\ram16x8.cxf

..................\.......\........\........\.......\ram16x8.gen

..................\.......\........\........\.......\ram16x8.log

..................\.......\........\........\.......\ram16x8.shx

..................\.......\........\........\.......\ram16x8.v

..................\.......\........\........\.......\ram16x8_R0C0.mem

..................\.......\........\........\ram16x8_work.ixf

..................\.......\........\........\smartgen.aws

..................\.......\........\.timulus\BtimErrors.log

..................\.......\........\........\files_to_build.txt

..................\.......\........\........\multiply.dsk

..................\.......\........\........\multiply.hpj

..................\.......\........\........\multiply_tbench.bk

..................\.......\........\........\multiply_tbench.btim

..................\.......\........\........\multiply_tbench.v

..................\.......\........\........\waveperl.log

..................\.......\........\.ynthesis\.recordref

..................\.......\........\.........\multiply.areasrr

..................\.......\........\.........\multiply.edn

..................\.......\........\.........\multiply.fse

..................\.......\........\.........\multiply.htm

..................\.......\........\.........\multiply.map

..................\.......\........\.........\multiply.sap

..................\.......\........\.........\multiply.sdf

..................\.......\........\.........\multiply.srd

..................\.......\........\.........\multiply.srm

..................\.......\........\.........\multiply.srr

..................\.......\........\.........\multiply.srs

..................\.......\........\.........\multiply.tlg

..................\.......\........\.........\multiply_sdc.sdc

..................\.......\........\.........\multiply_syn.prj

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