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2020年09月04日 | STM32——时钟
2020-09-04 来源：eefocus
高速–外部时钟外接晶振
高速–内部时钟
低速–外部时钟LSE：外接晶振
低速–内部时钟LSI：RC震荡
锁相环倍频输出
PLLclk和PLL48ck的来源
主 PLL 时钟第一个高速时钟输出 PLLP 的计算方法
我们的外部晶振选择 8MHz。同时我们设置相应的分频器 M=8，倍频器倍频系数 N=336，
分频器分频系数 P=2，那么主 PLL 生成的第一个输出高速时钟 PLLP 为：
如果我们选择HSE为PLL时钟源，同时SYSCLK时钟源为PLL，那么SYSCLK时钟为 168MHz。
这对于我们后面的实验都是采用这样的配置。
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史海拾趣
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我希望能创建：（1）电子产业企业版面可以展现目前的前沿科技（2）每个小栏目如单片机栏目，可以再细分下，1）单片机资料区2）单片机竞赛区 3）单片机应用区---（3）搭建一个人才展现区，供企业与个人互选，为高校、专业技术人才为人生的道路提供一 ...… 查看全部问答＞ |
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各位大侠，请帮帮忙忙，要不过年回不了家了。 最近我在用网眼V2000的摄像头（ov511+ov7620），用得开发板是TI 公司的OMAP3530，芯片是OMAP3530处理器（600MHZ的ARM内核及430MHZ的DSP内核），想在wince6.0下用它来采集图像，编译好了一个驱动Ov511. ...… 查看全部问答＞ |
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新做了一款板，CPU用的是stm32f103vct6，上电连JTAG怎么都连不上，IAR报错：can\'t halt the core！请教各位：错误出在哪儿了？仔细检查了电源、地、晶振、BOOT、JTAG接口，没发现异常。郁闷中...… 查看全部问答＞ |