[资料分享] 【设计工具】【配置知识】Virtex-5_FPGA_的配置

配置方案

Xilinx 为终端用户提供了配置 Virtex-5 FPGA 所需的灵活性。Virtex-5 FPGA 支持以下方案：

串行

最简单的配置方案，串行吞吐量。

主串行

Xilinx FPGA 驱动 Xilinx PROM CLK，因为 Xilinx PROM 为 Xilinx FPGA 提供了串行（x1）配置数据。

从串行

Xilinx PROM 的内部振荡器驱动 Xilinx FPGA CCLK，因为 Xilinx PROM 为 Xilinx FPGA 提供了串行（x1）配置数据。

从串行

外部时钟驱动 Xilinx PROM CLK，Xilinx PROM 驱动 Xilinx FPGA CCLK，因为 Xilinx PROM 为 Xilinx FPGA 提供了串行（x1）配置数据。

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从串行

外部时钟驱动 Xilinx FPGA CLK 和 Xilinx PROM CLK，因为 Xilinx PROM 为 Xilinx FPGA 提供了串行（x1）配置数据。

主 SPI

Virtex-5 FPGA 驱动 SPI PROM 时钟，因为 SPI PROM 为 Virtex-5 FPGA 提供了串行（x1）配置数据。

并行

并行配置，可以实现最快速的吞吐量

主并 (Master-SelectMap)

Xilinx FPGA 驱动 Xilinx PROM CLK，因为 Xilinx PROM 为 Xilinx FPGA 提供了字节宽的（x8）配置数据。

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从并 (slave-SelectMAP)

Xilinx PROM 的内部振荡器驱动 Xilinx FPGA CCLK，因为 Xilinx PROM 为 Xilinx FPGA 提供了字节宽的（x8）配置数据。

从并 (slave-SelectMAP)

外部时钟驱动 Xilinx PROM CLK，Xilinx PROM 驱动 Xilinx FPGA CCLK，因为 Xilinx PROM 为 Xilinx FPGA 提供了字节宽的（x8）配置数据。

从并 (Slave-SelectMAP)

外部时钟驱动 Xilinx FPGA CCLK 和 Xilinx PROM CLK，因为 Xilinx PROM 为 Xilinx FPGA 提供了字节宽的（x8）配置数据。

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主 BPI

Virtex-5 FPGA 驱动并行 Flash PROM，因为并行 Flash PROM 为 Virtex-5 FPGA 提供了字节宽的（x8）配置数据。