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FPGA/CPLD
FPGA与DSP间的通信
ustczhujian
2013-1-19 09:16
楼主
•
跨时钟域的设计
:FIFO,
双
RAM,RAM+MUX,
等
•
编写
FPGA
程序实现
DSP
的外设
•
编写
DSP
程序
,
通过
EMIF
接口访问
FPGA
内部的存储器
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回复评论 （1）
沙发
eeleader
很好，不错！能更详细些吗？正需要呢。
一个为理想不懈前进的人，一个永不言败人！ http://shop57496282.taobao.com/ 欢迎光临网上店铺！
点赞
2013-1-20 21:10
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• 跨时钟域的设计:FIFO,双RAM,RAM+MUX,等
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