Preliminary Information
AMD Duron
Processor
Data Sheet
TM
Publication #
23802
Rev:
C
Issue Date:
August 2000
Preliminary Information
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Preliminary Information
23802C—August 2000
AMD Duron™ Processor Data Sheet
Contents
Revision History. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . xi
1
2
Overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1
1.1
2.1
2.2
2.3
2.4
AMD Duron™ Processor Microarchitecture Summary . . . . . 2
Overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5
Signaling Technology . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5
Push-Pull (PP) Drivers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 6
AMD System Bus Signals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 6
Interface Signals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5
3
4
Logic Symbol Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7
Power Management . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9
4.1
Power Management States . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9
Full-On . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10
Halt State . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10
Stop Grant and Sleep States. . . . . . . . . . . . . . . . . . . . . . . . . . . 10
Probe State. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11
Connection and Disconnection Protocol . . . . . . . . . . . . . . . . 11
Connection Protocol . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 12
Connection State Machines . . . . . . . . . . . . . . . . . . . . . . . . . . . 15
4.2
5
6
Thermal Design . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17
Electrical Data . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
6.1
6.2
6.3
6.4
6.5
6.6
6.7
6.8
6.9
6.10
6.11
6.12
6.13
Conventions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20
Voltage Identification (VID[4:0]) . . . . . . . . . . . . . . . . . . . . . . 21
Frequency Identification (FID[3:0]) . . . . . . . . . . . . . . . . . . . . 21
VCCA AC and DC Characteristics . . . . . . . . . . . . . . . . . . . . . 21
Decoupling . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22
Operating Ranges . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22
Absolute Ratings . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22
Power Dissipation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
SYSCLK and SYSCLK# DC and AC Characteristics . . . . . . 23
AMD System Bus Pins AC/DC Characteristics . . . . . . . . . . . 25
AMD System Bus AC Characteristics . . . . . . . . . . . . . . . . . . . 26
General AC and DC Characteristics . . . . . . . . . . . . . . . . . . . . 27
APIC Pins AC and DC Characteristics . . . . . . . . . . . . . . . . . . 29
Contents
iii
Preliminary Information
AMD Duron™ Processor Data Sheet
23802C—August 2000
7
Signal and Power-Up Requirements . . . . . . . . . . . . . . . . . . . . .31
7.1
Power-Up Requirements . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Signal Sequence and Timing Description . . . . . . . . . . . . . . .
Clock Multiplier Selection (FID[3:0]). . . . . . . . . . . . . . . . . . .
Processor Warm Reset Requirements . . . . . . . . . . . . . . . . . .
The AMD Duron™ Processor and Northbridge
Reset Pins . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
31
31
34
36
36
7.2
8
Mechanical Data . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .37
8.1
8.2
8.3
Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
Pinout Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
Socket Tabs for Heatsink Clips . . . . . . . . . . . . . . . . . . . . . . . 39
Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Pin List . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Detailed Pin Descriptions . . . . . . . . . . . . . . . . . . . . . . . . . . . .
A20M# Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
AMD Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
AMD System Bus Pins . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Analog Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
CLKFWDRST Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
CLKIN, RSTCLK (SYSCLK) Pins . . . . . . . . . . . . . . . . . . . . . .
CONNECT Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
COREFB and COREFB# Pins . . . . . . . . . . . . . . . . . . . . . . . . .
DBRDY and DBREQ# Pins. . . . . . . . . . . . . . . . . . . . . . . . . . . .
FERR Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
FID[3:0] Pins . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
FLUSH# Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
IGNNE# Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
INIT# Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
INTR Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
JTAG Pins . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
K7CLKOUT and K7CLKOUT# Pins . . . . . . . . . . . . . . . . . . . .
Key Pins . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
NC Pins . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
NMI Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
PGA Orientation Pins . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
PLL Bypass and Test Pins . . . . . . . . . . . . . . . . . . . . . . . . . . . .
PWROK Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
SADDIN[1]# and SADDOUT[1:0]# Pins . . . . . . . . . . . . . . . . .
Scan Pins . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
41
49
57
57
57
57
57
57
57
57
57
57
58
58
59
59
59
59
59
59
59
60
60
60
60
60
60
61
9
Pin Descriptions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .41
9.1
9.2
9.3
iv
Contents
Preliminary Information
23802C—August 2000
AMD Duron™ Processor Data Sheet
SCHECK[7:0]# Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 61
SMI# Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 61
STPCLK# Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 61
SYSCLK and SYSCLK# Pins . . . . . . . . . . . . . . . . . . . . . . . . . . 61
SYSVREFMODE Pin. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 61
VCCA Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 61
VID[4:0] Pins . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 61
VREFSYS Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 62
ZN, VCC_Z, ZP, and VSS_Z Pins . . . . . . . . . . . . . . . . . . . . . . . 62
10
Ordering Information . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 65
Standard AMD Duron™ Processor Products . . . . . . . . . . . . . . . . . . . 65
Appendix A Conventions, Abbreviations, and References . . . . . . . . . . . . . . . . . . . . 67
Signals and Bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 67
Data Terminology . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 68
Abbreviations and Acronyms. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 69
Contents
v
