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2020年02月24日 | stm32_HSI
2020-02-24 来源：eefocus
stm32启动时使用的是外部8M晶振，在system_stm32f10x.c文件中有定义，且使用的函数为void SystemInit (void)
使用外部晶振HSE时的代码如下
void SystemInit (void)
{
// /* Reset the RCC clock configuration to the default reset state(for debug purpose) */
// /* Set HSION bit */
// RCC->CR |= (uint32_t)0x00000001;
// /* Reset SW, HPRE, PPRE1, PPRE2, ADCPRE and MCO bits */
//#ifndef STM32F10X_CL
// RCC->CFGR &= (uint32_t)0xF8FF0000;
//#else
// RCC->CFGR &= (uint32_t)0xF0FF0000;
//#endif /* STM32F10X_CL */
//
// /* Reset HSEON, CSSON and PLLON bits */
// RCC->CR &= (uint32_t)0xFEF6FFFF;
// /* Reset HSEBYP bit */
// RCC->CR &= (uint32_t)0xFFFBFFFF;
// /* Reset PLLSRC, PLLXTPRE, PLLMUL and USBPRE/OTGFSPRE bits */
// RCC->CFGR &= (uint32_t)0xFF80FFFF;
//#ifdef STM32F10X_CL
// /* Reset PLL2ON and PLL3ON bits */
// RCC->CR &= (uint32_t)0xEBFFFFFF;
// /* Disable all interrupts and clear pending bits */
// RCC->CIR = 0x00FF0000;
// /* Reset CFGR2 register */
// RCC->CFGR2 = 0x00000000;
//#elif defined (STM32F10X_LD_VL) || defined (STM32F10X_MD_VL) || (defined STM32F10X_HD_VL)
// /* Disable all interrupts and clear pending bits */
// RCC->CIR = 0x009F0000;
// /* Reset CFGR2 register */
// RCC->CFGR2 = 0x00000000;
//#else
// /* Disable all interrupts and clear pending bits */
// RCC->CIR = 0x009F0000;
//#endif /* STM32F10X_CL */
//
//#if defined (STM32F10X_HD) || (defined STM32F10X_XL) || (defined STM32F10X_HD_VL)
// #ifdef DATA_IN_ExtSRAM
// SystemInit_ExtMemCtl();
// #endif /* DATA_IN_ExtSRAM */
//#endif
// /* Configure the System clock frequency, HCLK, PCLK2 and PCLK1 prescalers */
// /* Configure the Flash Latency cycles and enable prefetch buffer */
// SetSysClock();
//#ifdef VECT_TAB_SRAM
// SCB->VTOR = SRAM_BASE | VECT_TAB_OFFSET; /* Vector Table Relocation in Internal SRAM. */
//#else
// SCB->VTOR = FLASH_BASE | VECT_TAB_OFFSET; /* Vector Table Relocation in Internal FLASH. */
//#endif
}
现在改为使用内部晶振
void SystemInit (void)
{
RCC->CR |= (uint32_t)0x00000001;
/*选择HSI为PLL的时钟源HSI必须2分频给PLL*/
RCC->CFGR |= (uint32_t)RCC_CFGR_PLLSRC_HSI_Div2;
/*PLLCLK=8/2*13=52MHz 设置倍频得到时钟源PLL的频率*/
RCC->CFGR |= (uint32_t)RCC_CFGR_PLLMULL4; //四倍频
/* PLL不分频输出 */
RCC->CFGR |= (uint32_t)RCC_CFGR_HPRE_DIV1;
/* 使能 PLL时钟 */
RCC->CR |= RCC_CR_PLLON;
/* 等待PLL时钟就绪*/
while((RCC->CR & RCC_CR_PLLRDY) == 0);
/* 选择PLL为系统时钟的时钟源 */
RCC->CFGR &= (uint32_t)((uint32_t)~(RCC_CFGR_SW));
RCC->CFGR |= (uint32_t)RCC_CFGR_SW_PLL;
/* 等到PLL成为系统时钟的时钟源*/
while ((RCC->CFGR & (uint32_t)RCC_CFGR_SWS) != (uint32_t)0x08);
}
倍频备注：倍频可以从6M到45M，通过修改RCC_CFGR_PLLMULL4，此处与数据手册说法有一点不符合，但是通过示波器实际测出是可以的。计算公式system_clk=6M/2*倍频数
至于为何是6M,怀疑可能是内部RC晶振有点问题或者配置问题待解决
使用内部RC晶振时，delay函数不能用，计时不准确
史海拾趣