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据说大部分设计都是verilog .可惜学校大部分是VHDL
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不过这个都不是问题,现在所有编译器都只支持VHLD与VERILOG混合调用,所有的VHDL语言都可以在外面加一个VERILOG的套子装起来,然后用VERILOG的工具来仿真,调用之类!
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学习FPGA选择verilog还是vhdl
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