本课程为精品课,您可以登录eeworld继续观看: 提高FPGA的利用率和性能:UltraScale 架构继续观看 课时1:SDSoC开发环境详情介绍与演示 - Part 1:估算与实现 课时2:SDSoC开发环境详情介绍与演示 - Part 2:优化与调试 课时3:Vivado 2014.3 中的更新信息 课时4:业界最大半导体器件VU440 FPGA 性能演示 课时5:4K UHD 实时视频引擎演示(DisplayPort 1.2以及HDMI 1.4/2.0) 课时6:UltraScale FPGA演示150Gb/s 集成的Interlaken性能 课时7:UltraScale架构实现最高利用率和出色性能 课时8:提高FPGA的利用率和性能:UltraScale 架构 课时9:Zynq 7000 All Programmable SoC低功耗方案 课时10:如何使用Vivado IP集成器打包自定义IP 课时11:Xilinx UltraScale器件的部分重配置功能 课时12:使用Vivado Device Programmer对FPGA进行非直接编程 课时13:使用AES加密BBR RAM(Battery-Backed RAM) 课时14:5分钟用SDK在Zynq上运行“Hello World” 课时15:创建Zynq PCIe Root Complex变得更容易 课时16:用C/C++开发全可编程SoC和MPSoC 课时17:SDSoC开发环境:实例演示 课时18:岂止一步之遥:业界首款16nm产品正式发布 课时19:16nm MPSoC 提供领先一代的集成度与智能化 课时20:面向数据中心应用的SDAccel开发环境介绍 课时21:SDAccel 开发环境:实例演示 课程介绍共计21课时,3小时32分9秒 Xilinx SDSoC开发环境特色功能演示 Xilinx SDSoC开发环境特色功能演示 上传者:chenyy 正在载入数据,请稍等... 猜你喜欢 直播回放: TI MSPM0应用详解:个人电子、楼宇自动化和医疗 Microchip超低功耗LCD单片机PIC18F87K90 正点原子手把手教你学OneOS 电源设计小贴士27:压降式并行电源供应 电机和电机控制的简介:AC 感应电机 满足工业应用中的低静态电流需求的宽输入 DC/DC 转换器 TI DLP LightCrafter DLP2000 EVM板介绍 TI LED lighting 在汽车中的运用 热门下载 工业机器人 LED节能筒灯认证规范 基于反电势过零检测无刷直流电机控制系统的设计与研究 数字信号处理中 OLED VGF160128的驱动程序(单片机C语言编写) 第04章 JSP语法.ppt FS8108 s60菜单的应用,list menu items 显卡的低通滤波电路 USB接口芯片CH374所有应用源码 热门帖子 蓝牙4.0协议栈按键流程分析笔记 之前在蓝牙技术群看到好多网友不知道按键流程到底是什么情况,平时也没时间,在群里也一两句说不明白,也就说了下可以去看下zigbee按键流程过程,其实都是相通的,现在特意发帖分享下,希望能起到一个抛砖引玉的作用。在介绍蓝牙按键流程分析之前,我们需要了解一个概念,那就是就是OSAL。什么是OSAL呢?可能大伙对于OS是比较了解的,学了计算机的搞过OS的也基本接触过,简单来说就是一个操作系统抽象层,可以理解为运行在CC2540上的操作系统,说操作系统还不能算,TI的OSAL只实现了任务切 wateras1 求教波形是如何产生的 书上说,方波通过上面的电路,输出的波形如下:请高手给详解一下波形产生的过程\0\0\0eeworldpostqq求教波形是如何产生的没有输入波形,谈什么输出波形如何产生?猜测输入是持续时间为t1~t3(实际要比t3早一些结束)的矩形脉冲。如果是的话,那么t1~t3的输出是由于输入脉冲使三极管V2饱和导通产生的,t3~t4较低的“平台”是变压器电感储能产生的(此时三极管已关断)。maychang发表于2015-2-100:38没有输入波形,谈什么输出波形如何产生 通通 最佳兼容性和快速USB充电方案(D1522,21应用资料) \0\0\0eeworldpostqq最佳兼容性和快速USB充电方案(D1522,21应用资料) blink VerilogHDL那些事 \0\0\0eeworldpostqqVerilogHDL那些事这本电子书不错黑金出品的谢谢楼主分享 HHeLi 学习学习高大上的——波音747中文操作手册 波音747-400型客机的中文操作手册,好复杂的系统!真是高大上的学习资料啊,不知道你是否有兴趣啊。http://download.eeworld.com.cn/detail/castor_xu/551429学习学习高大上的——波音747中文操作手册这种文档都能弄到?强!!有空了学习学习,说不定哪天双色球系统出错,让我中了5个亿,买一架玩玩哈哈,我就盼着那一天啦,也跟着蹭蹭头等舱坐坐!看看再说!!嗯,肯定有心得! 快羊加鞭 关于时序约束 一直以来对可编程逻辑器件的时序约束都没有本质理解,现在碰到一下情况:有两个信号同时从CPLD管脚进去,经过不同的逻辑从管脚出来,因为经过的逻辑不同,内部布线不同,导致两个信号先后出来,是不是通过时序约束可以控制内部走线,是两个信号尽可能同步出来?如果可以,应该怎么约束呢?有经验的大侠给点指导,不胜感激啊!关于时序约束这个要求有点高,你进去的是异步信号,要求同步出来。我估计唯一的办法,就是用RAM或中间寄存器缓冲,然后用系统时钟同步输出。靠布线同步,基本上臆想天开!你这个两个不同逻辑 771235870 网友正在看 5 动手实验 - ADC 噪声 云端制造 13.1 雾计算基础 平衡搜索树 Basic MOS Device Physics 设置差分对 第四讲核心板PCB绘制 Ep17 Semiconductor Engineering 信号与系统38