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课程介绍共计30课时，21小时25分16秒

verilog HDL数字集成电路设计原理与应用
Verilog HDL数字集成电路设计原理与应用 蔡觉平 何小川 西安电子科技大学 蔡觉平、李振荣主讲
上传者：桂花蒸
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探路者
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