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- 实验二（续）：Makefile中的自动化变量
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课时1：u-boot的版本选择
课时2：u-boot的异常向量表，V210的启动机制原理
课时3：用objdump反汇编查看u-boot的头部代码和异常向量处理
课时4：ENTRY等宏的展开，CPSR寄存器的设置
课时5：CP15协处理器基础，VBAR异常向量表基址映射
课时6：cpu_init_cp15子过程分析： cache的操作
课时7：cpu_init_cp15子过程分析（续）：分支预测、MMU操作
课时8：cpu_initcrit子过程分析，实验一：修改u-boot源代码使其用LED灯显示运行状态
课时9：实验一（续）：GPIO输入输出的电路分析
课时10：实验一（续）：制作u-boot烧写镜像的原理，mkv210源代码分析
课时11：实验一（续）：用hexdump工具分析镜像的16进制代码
课时12：编译、链接、汇编过程概述
课时13：实验二：编写自己的boot程序：myboot
课时14：实验二（续）：两个以上文件的链接原理
课时15：实验二（续）：反汇编分析自己的myboot
课时16：实验二（续）：利用Makefile自动化编译myboot
课时17：实验二（续）：改进我们的Makefile
课时18：实验二（续）：Makefile中的自动化变量
课时19：芯片型号判断，复位方式判断
课时20：IO保持、复位方式判断、中断初始化
课时21：UART初始化与异步通信原理
课时22：UART分析1
课时23：UART分析2
课时24：UART分析3
课时25：UART分析4
课时26：实验三：用UART显示某指定内存中的数据
课时27：DDR内存的基本原理1
课时28：DDR内存的基本原理2
课时29：DDR内存的基本原理3
课时30：DDR内存的在V210开放板上的硬件连接1
课时31：DDR内存的在V210开放板上的硬件连接2
课时32：DDR2-Device的内部结构1
课时33：DDR2-Device的内部结构2
课时34：DDR2-操作的有限状态机
课时35：DDR2的MRS和EMRS寄存器
课时36：DDR2的读写时序
课时37：DDR2的读写时序x
课时38：DDR2初始化代码分析1
课时39：DDR2初始化代码分析2
课时40：DDR2初始化代码分析3
课时41：DDR2初始化代码分析4
课时42：DDR2初始化代码分析5
课时43：DDR2初始化代码分析6
课时44：DDR2初始化代码分析7
课时45：DDR2初始化代码分析8
课时46：DDR2初始化代码分析9
课时47：DDR2初始化代码分析10
课时48：编写自己的DDR初始化代码1
课时49：编写自己的DDR初始化代码2
课时50：board_init_f函数分析1
课时51：board_init_f函数分析2
课时52：mmc_relocate分析
课时53：实验五：将u-boot.bin从SD卡搬运到DDR内存中
课时54：实验五：将u-boot.bin从SD卡搬运到DDR内存中2
课时55：u-boot的链接镜像结构分析
课时56：board_init_f函数分析3
课时57：board_init_f函数分析4
课时58：board_init_f函数分析5
课时59：board_init_f函数分析6
课时60：board_init_f函数分析7
课时61：u-boot的自举实现
课时62：relocate_code汇编自举代码分析
课时63：板级初始化的后半部分：bord_init_r函数分析1
课时64：板级初始化的后半部分：bord_init_r函数分析2
课时65：板级初始化的后半部分：bord_init_r函数分析3
课时66：板级初始化的后半部分：bord_init_r函数分析4
课时67：跳转到主循环，main_loop
课时68：主循环分析：u-boot 解析终端输入命令行的原理
课时69：主循环分析：u-boot 的命令执行实现
课时70：bootm启动流程分析1
课时71：bootm启动流程分析2
课时72：bootm启动流程分析3
课时73：bootm启动流程分析4
课程介绍共计73课时，1天36分23秒
